LPC2377/78 único chip de 16 bits/32 bits de microcontroladores; 512 kB flash con ISP/IAP, Ethernet, USB 2.0, puede y ADC de 10 bits/CAD
Descripción general
La LPC2377/78 microcontroladores se basan en un 16 bits/32 BITS ARM7TDMI-S CPU con emulación en tiempo real que combina el microcontrolador integrado con 512 kB de memoria flash de alta velocidad. Una de 128 bits de ancho de la interfaz de memoria y una única arquitectura de acelerador de habilitar la ejecución de código 32 bits a la máxima velocidad de reloj. Para el rendimiento de la crítica en las rutinas de servicio de interrupción y DSP de algoritmos, esto aumenta el rendimiento hasta un 30 % en el modo de pulgar. Para aplicaciones de tamaño de código crítico, la alternativa de pulgar de 16 bits de código de modo reduce en más del 30 % con una mínima de rendimiento.
La LPC2377/78 son ideales para comunicación serie multiuso aplicaciones. Incorpora un controlador de acceso a medios de comunicación Ethernet 10/100 (MAC), el dispositivo USB de velocidad completa con 4 kB de RAM de endpoint (LPC2378 solamente), cuatro UARTs, dos canales (LPC2378 solamente), una interfaz SPI, dos puertos serie síncrono (SSP), tres I2C-bus interfaces, un bus I2S de interfaz, y un controlador de memoria externa (EMC). Esta combinación de interfaces de comunicaciones serie combinado con un chip 4 MHz oscilador interno, SRAM de 32 kB, 16 kB de memoria SRAM para Ethernet, de 8 kB de memoria SRAM para USB y uso general, junto con la batería de 2 kB de memoria SRAM que este dispositivo adecuado para gateways de comunicación y protocolo convertidores. Diversos temporizadores de 32 bits, un mejoramiento de la ADC de 10 bits, DAC de 10 bits, PWM, unidad de una unidad de control, y hasta 104 líneas de GPIO rápido con hasta 50 borde y hasta cuatro sensibles a nivel de los pasadores de interrupción externa hacen de estos microcontroladores adecuado para el control industrial y sistemas médicos.
Características y ventajas
• El brazo7TDMI-S, el procesador funciona a 72 MHz.
• Hasta 512 kB flash on-chip de memoria de programa con In-System Programming (ISP) y In-Application Programación (IAP) de capacidad. El programa flash de memoria en el brazo bus local para acceso a la CPU de alto rendimiento.
• 32 kB de memoria SRAM en el brazo bus local para acceso a la CPU de alto rendimiento.
• 16 kB de memoria SRAM para interfaz Ethernet. También puede utilizarse como objetivo general de la SRAM.
• 8 kB de memoria SRAM para uso general DMA; también accesible por USB.
• Doble de alto rendimiento avanzado Bus (AHB) sistema que proporciona para interpretación simultánea DMA DMA de Ethernet, USB, y la ejecución del programa de chip flash sin contención entre esas funciones. Un bus puente permite que el DMA de Ethernet para acceder a los demás AHB subsistema.
• EMC proporciona soporte para dispositivos estáticos como flash y SRAM, así como fuera del chip asignados a la memoria de los periféricos.
• Avanzada Vectored Controlador de Interrupciones (CIV), admite hasta 32 vectored interrupciones.
• Objetivo general El controlador de DMA (GPDMA) AHB que puede utilizarse con interfaces seriales de la SSP, el I2S de puerto, y de la Secure Digital/MultiMediaCard (SD/MMC) puerto de la tarjeta, así como para la memoria a la memoria de las transferencias.
• Las interfaces de serie:
-- Ethernet MAC asociada con el controlador de DMA. Estas funciones se encuentran en un independiente AHB.
-- USB 2.0 de alta velocidad dispositivo con chip PHY y asociado el controlador de DMA (LPC2378 solamente).
- Cuatro UARTs con fracciones de la generación de velocidad en baudios, uno con un módem con el control de E/S, uno con el apoyo de IrDA, todas con FIFO.
-- Pueden controlador con dos canales (LPC2378 solamente).
-- Controlador de SPI.
-- Dos controladores con SSP FIFO y multi-protocolo de capacidades. Es una alternativa para el puerto de SPI, compartiendo su interrupción y pasadores. Estos controladores pueden utilizarse con el GPDMA controlador.
-- Tres I2C-bus interfaces (uno con open-drain y dos con patillas puerto estándar).
-- I2S (Inter-IC Sound) Interfaz para la entrada o salida de audio digital. Puede ser utilizado con el GPDMA.
• Otros periféricos:
-- Tarjeta de memoria SD/MMC de interfaz.
-- 104 E/S de propósito general pins configurable con pull-up/down resistencias.
-- 10 bits de entrada de ADC con multiplexado entre 8 patillas.
-- 10-bit DAC.
-- Cuatro contadores y temporizadores de propósito general con 8 entradas de captura y el 10 de comparar los resultados. Cada bloque de programación tiene una entrada de conteo de externos.
-- Un PWM/bloque de programación con soporte para motor trifásico de control. El PWM externo tiene dos entradas de recuento.
- Reloj en tiempo real (RTC) separadas con clavija de alimentación, fuente de reloj puede ser el oscilador de RTC o reloj de la APB.
--- 2 kB de memoria SRAM alimenta de la RTC clavija de alimentación, permitiendo que los datos almacenados, cuando el resto del chip está apagado.
-- Temporizador WatchDog (WDT). La WDT puede cronometrar desde el oscilador RC interno, el oscilador de RTC, o de la APB reloj.
• Brazo estándar de interfaz de depuración/prueba de compatibilidad con las herramientas existentes.
• Módulo admite la traza de emulación traza en tiempo real.
• La única fuente de alimentación de 3,3 V (3.0 V a 3,6 V).
• Cuatro modos de potencia reducida: inactivo, el sueño, apagar, y una profunda desconexión del sistema.
• Cuatro interrupción externa entradas configurables como edge/nivel sensible. Todos los pasadores en los puertos 0 y 2 puede utilizarse como fuentes de interrupción sensible canto.
• Procesador wake-up desde el modo de apagado a través de cualquier interrupción capaz de funcionar durante el modo de apagado (incluye interrupciones externas, RTC interrumpir la actividad, USB, Ethernet
Wake-up interrupción).
• Dos dominios independientes de energía permiten afinar el consumo de energía basada en funciones necesarias.
• Cada periférico tiene su propio clock divider para profundizar el ahorro de energía.
• El apagón parcial detectar con distintos umbrales para interrumpir y obligado a restablecer.
• On-chip encendido reset.
• On-chip Oscilador de cristal con un rango de funcionamiento de 1 MHz a 25 MHz.
• 4 MHz oscilador RC interno recortado a un 1 % de exactitud que opcionalmente puede ser utilizado como el reloj del sistema. Cuando se usa como reloj de la CPU, no puede permitir y USB.
• On-chip CPU PLL permite el funcionamiento hasta la tasa máxima de CPU sin la necesidad de un cristal de alta frecuencia. Se puede ejecutar desde el oscilador principal, el oscilador RC interno, o de la RTC oscilador.
• Exploración de límites para simplificar la junta de la prueba.
• Versátil polo las selecciones de la función de permitir que más posibilidades de utilización del chip funciones periféricas.
Aplicaciones
• El control industrial
• Medical Systems
• Convertidor de protocolo
• Comunicaciones
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Perfil de empresa
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3.La respuesta inmediata para cualquier pregunta e investigación en el menor tiempo posible.
4.directamente de fábrica, reducir sus costes y ahorrar tiempo.
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Preguntas frecuentes
Q1 . Lo que su MOQ?
A1 .Si no se especifica, el 1 de PCS es ok,independientemente de cuántos necesita ,y también vamos a darle el mejor servicio.
La certificación Q2.Lo conseguiste ?
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Q3 :lo que sobre el paquete y la entrega,se rompió durante el envío?
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Q5. me dicen algunos detalles acerca de la orden del tiempo.
A5:Le damos la promesa si alguna cuestión durante 1 año y no a causa de los factores humanos,vamos a solucionarlo .
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